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一种嵌入式微控制器的指令 Cache设计方案 2025年 指令 Cache设计方案中,VTag存储器大小取决于处理器的总线宽度以及指令 Cache的Cache行数和Cache行大小。本文提出了一种优化指令 Cache的电路设计,通过减小指令 Cache覆盖的取指空间,在不影响指令 Cache对外接口的总线宽度以及Cache行数和Cache大小的情况下,进一步减小了VTag存储器的大小。本文用DC(Design Compiler)对指令 Cache进行综合,结果表明,本文设计实现的指令 Cache较传统方案在减少芯片面积的同时,显著提升了电路频率,对嵌入式微控制器的指令 Cache设计具有重要的实用价值。关键词：嵌入式 微控制器 处理器 指令CACHE 分离式指令 cache 结构 指令 cache 结构，将指令 cache 拆分为两部分，一部分称为BIC(Branch Information Cache)，另一部分称为RIC(Remainder Information Cache)。由于...一种基于可重构指令 cache 的低功耗设计方法 指令 cache 的硬件低功耗设计方法。针对不同cpu的软件编译特性，以及整个应用程序不同阶段编译出的指令 特征，提供检测不同程序段对不同cache 优化策略适配性的软件环境，结合软件环境给出的cache 不...一种缓存行长可变的指令 Cache系统 指令 Cache系统，包括两种缓存行长的模式，所述两种缓存行长的模式分别为添加参数监测程序的模式和判断、控制缓存访问的模式；所述添加参数监测程序的模式为在硬件逻辑中添加相关参数监测程序，使得空...基于指令 Cache和寄存器压力的循环展开优化 被引量：2 2022年 指令 级并行程度和数据局部性,提升循环的执行效能。然而,过度的循环展开会造成指令 Cache溢出,增大寄存器压力,循环展开次数太少又会浪费潜在的性能提升机会,因此寻找恰当的展开因子是研究循环展开问题的核心。基于GCC开源编译器,面向循环展开问题开展深入的分析与研究,针对指令 Cache和寄存器资源对循环展开的影响,提出了一种基于指令 Cache和寄存器压力的循环展开因子计算方法,并在GCC编译器中实现了该计算方法。申威和海光平台上的实验结果显示,相较于目前GCC中存在的其它展开因子计算方法,所提出的方法可以获得更为有效的循环展开因子,提升了程序性能。在SPEC CPU 2006测试集上的平均性能分别提升了2.7%和3.1%,在NPB-3.3.1测试集上的分别为5.4%和6.1%。关键词：指令CACHE 应用于MCU中低功耗指令 Cache的设计 指令 和数据的频繁访存是MCU动态功耗的主要组成部分，采用指令 缓存（Cache）可以有效减...关键词：静态随机存取存储器 静态功耗 处理器指令 Cache单粒子翻转软错误的防护方法 指令 Cache单粒子翻转软错误的防护方法，该方法，包括：确定处理器指令 Cache单粒子翻转所引起的故障异常类型；根据故障异常类型，绑定单粒子翻转软错误恢复函数；根据故障异常类型，启动相应的单粒子翻转...文献传递 一种基于非阻塞指令 cache 的指令 读取方法 指令 cache 的指令 读取方法，其中，非阻塞指令 cache 中设置有索引标志寄存器组，索引标志寄存器组用于存储索引标志，基于非阻塞指令 cache 的指令 读取方法包括：判断指...文献传递 面向处理器指令 cache 的低功耗编译方法 指令 cache 的低功耗编译方法，包括以下步骤：S1、寻找最内层循环；S2、判断寻找到的最内层循环是否可以展开；S3、结合L0 cache 计算展开次数：即根据循环体的最大伪指令 条数MAX_UNROL...文献传递 分离式指令 cache 结构 指令 cache 结构，将指令 cache 拆分为两部分，一部分称为BIC(Branch Information Cache)，另一部分称为RIC(Remainder Information Cache)。由于...文献传递
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